rtl8367s需要写程序吗

设计流程上有阿，挑文件啊，然后呢，你经过后端，然后到 gds 版图，再到封装测试，再到芯片，所以你会发现就是 什么设计制造分册，然后最后形成一个芯片。那黑色里面就是我们要写的代码啊，写的代码，这是一个八零五幺的啊， dp 应该是 date， pass， tr 啊，我，我就把它当做 ctrl 吧，就是 datapass， ctrl 啊这类的一些一些信号，对不对？所以为什么我看到 dp 呢，就知道 datapass， 因为命名的时候呢，一般就是这样， day d 就是我，我联想呢，就是 date， date， pg， pass， 数据路径的一些控制啊之类的，对不对？ 所以在整个流程当中提到的 it t 二呢，就是 vlog 或者 vhdr， 那 vrlog 当然是我们最常用的， vhdr 呢，用的很少，所以现在几乎没人学， 我也是掉了啊，是这样来做的，所以啊， tl 就是 register transfer level。 嗯，你你可以简单认为是不是 love 写的代码啊，就这么简单，不用，刚开始不用理解太细。那写好的代码呢？我们 gds 版图就是画这些版图， 所以你会发现这就是已经至少有两个工种了，版图的跟写代码的，写代码呢，又分为设计的跟验证的，甚至还有前端叫 esl 的，所以很多。但前端的步骤到这些流程呢，就是输入需求到网表的过程，网表就 dc 啊，就会输出一个网表， 所以 iq 设计完了有验证，验证完了有今天实际分析，包括我们覆盖率的一些做法。那当然了，他还包含 ipg 的测试，其实很多验证呢啊，前端我们用一些 block 级别的验证，或者说用一些什么雷神级别的验证验一验，然后呢就扔给这个 ipg 的 啊，测试直接去测这个系统起来，那最后呢？到 a c 克的综合，所以这啊，整个呢就是一个完整的 流程，那这个流程验证的设计呢？是要反复去验，犹如啊，如果有做软件同学，你会发现他跟软件测试跟软件设计有点像啊，当然了，软件测试，呃，相比于软件设计的这个技术含量呢，要低很多，但是验证的设计的这个技术含量呢？嗯， 不会比设计低，甚至比他更高一些，因为他的抽象级更高，你所想办法的东西更多啊，想办法的东西，东西更多， 那比如说你要设计一个啊，简单的这样一个语文，那你就要写，这样穿代码才能出来。但是我们，但是我们一个项目经常讲到说多少门，对吧？经常说，哎， 几十亿门，几百亿门一个门，这就是一个门，几十亿门就是几十亿个这个东西，那你要一个一个这样写吗？肯定不是啦，对不对？所以你要去用行为级的 vlog 去写啊，行为级，所以他抽象层次又稍微高了一点 啊，当然现在还有更高级别的抽象层次，对吧？ xxl 呀，啊，包括这个 spano， hdr 啊，这些这些语言，那这些语言都是想提高我们的设计效率，那能不能取代了 hdr 呢啊？我个人认为，是 啊，要取代还是很难很难哈，这些 treesona hdr 呢，市场呢？依旧很小，依旧很小，所以不要被这些啊带节奏的人觉得，哎，你看这 vlog 都不行了，这个设计都不行了，要么被 it 带了，要么被这个更厉害的这些 trees 啊，或者 spond， hdr 这些替换了，对不对啊？但是事实 不是这个样子哈，大家要睁开眼睛去看市场。那你写完之后呢？还会去做检查，所以不是简单的写完写作业了，写完就 ok 了。并不是哈，一个芯片你投片要花那么多钱呢，所以都是非常慎重的啊，都是非常慎重的，所以要设计规则检查啊，包括 dft 的一些，包括 dft 的一些 dft 的一些检查，对吧？我们的 beast memory 里面插入一些这个烂齿啊，然后或者插入这个 register， 去用这个 扫描链去做一些扫描，对吧？这就是我们 dft 的一些测试啊，专门呢就会有一个 dft 工程师啊。 dft 工程师，你就想想这个数字的产业链上有多少岗位啊？ df 工程师，对吧？后端的布局不限工程师。那设计工程师，验证工程师啊，前面的算法不用说了，在前面的架构也不用说了，你想想这都多少了。那啊，当然有些呢， stadc 这些呢，也分到某些。

未来这几期呢，会做一个芯片相关知识的科普，包括设计、制造、封装、测试等方面，不会聊的太深，只是为了让更多的人了解一颗芯片从无到有是怎么来的。首先芯片的设计和制造是分开的，目前大部分的芯片公司都是 fabliss， 也就是没有自己的金元加工厂， 因为建金元厂的成本实在是太高了。这一期就先从芯片设计开始说吧，芯片设计可以分成两个部分，芯片的前端设计和后端设计。前端设计就是从输入需求到输出网表的过程，主要其实可以分为六个步骤， 第一是 rtr 的设计，第二是验证，第三是静态的时区分析，第四是覆盖率，第五是 ic 的逻辑综合。这一期呢，就先说一下 itr 设计，在设计之前呢，我们先要确定镜面的工艺，比如说是用哪个代工厂帮我们生产，是台积电啊还是三金啊，然后用的是七纳米还是 纳米工艺。而工艺的选择呢，也是有很多因素的制约，比如说该工艺下的芯片制造成本和设计成本，还有就是性能、工号面积、温度、寿命以及可实现的频率，可以支持的金属层数等。然后还有就是 fonder 也可以提供的第三方的 ipip 的功能性能和使用情况。 然后还有一些就是像工艺的成熟度啊，还有就是技术的需求。 ic 设计的第一步就是制定 spac， 这个步骤其实就像在设计建筑之前先要画好图纸一样，在确定好所有的功能之后再进行设计，这样才不用花额外的时间进行后续的修改。 ic 设计也需要经过类似的步骤，才能确保设计出来的芯片不会有任何差错。 用 rtl 实现的各种功能模块来组成一个实现具体功能的 ipsoc 芯片，最终是由 soc integration 工程师把各个 ip 集成到一起， ip 又分成模拟 ip 和数字 ip。 模拟 ip 主要包括 a， d， a， p， l， l， pad， flash 等 ip， 这些其实都和芯片的工艺相关，选定工艺后，然后就可以向相应的工艺厂进行购买。数字 ip 呢，主要包括 mac， nba， d， mac 等。呃，以及一些开文的 ip 和 和一些自主设计的 ap。 在芯片的功能设计完备之后，就要做可测性设计，也就是 dft 啊 t 幺设计。最后要做的就是代码的设计规则检查， 主要是针对电路的设计规则进行检查，包括代码的编写风格、 dft 命名规则和电路的综合相关规则等。然后这一步做完了之后就可以去做验证了。

那我们今天呢主要是给大家来分享这个神经网络的 rtl 级， rtl 级的开发基础就是 rtl 呢是计存器传输级 a chances later 来我，好，那么他需要潜导的知识呢，就是一个是这个 vivo 的这个使用啊， vivo 的使用开发环境的搭建就是安装，这个就是昨天我们最后让大家回去自己安装的，不知道安装完了吗？ 好，如果安装的过程中还有其他问题的话，那你可以这个给我们留言。 然后另外呢就是 rtl 级的开发的一个基本流程，就说你可以自己去跑一个简单的例子，比如说做一个基本的门操作，或者是做个简单 程序等等，然后还有神经网络理论的初步呢，这个我们昨天已经介绍了，特别是在卷机神经网络里面常用的那些算子怎么去计算。 然后对于 fbj 内部结构呢，就是这块可能有部分没有接触过的同学呢，还不太清楚啊，这个没有关系，因为不同的 fbj 芯片呢，他的内部结构资源是不一样的，所以我们在实际用过程中呢，会需要去查他的这个手册， 在手册里面确定他的资源来帮助我们选行。那么在这个今天的内容里面呢，会有一部分关于 fpj 选行的 啊，关于 fpj 选行的内容，所以这块呢是会讲到就是他内部的一些结构的。好，那么这是我们今天啊就是需要的钱岛知识。那么今天 主要给大家分享的呢，就是包含一些这个基础的准备啊，这个基础准备呢，主要涉及到这个数据的表示、量化等等这样的一些内容。然后呢还包含这个 昨天我们我们讨论的神经网络相关的基本算子的这个设计啊，以及实现的这个思路或者策略啊，其实就跟我们写软件似的，你这些算子 他的功能上确定完了之后，但实际上他的这个结构啊，他的结构是可以不一样的啊，并不唯一，那么你可以根据你的实际需求来进行选择他这个实现方式。 然后第三个呢，我们会给大家介绍一下在这个 fpj 内进行开发的时候常用的一些优化，优 优优化的策略其实就是一些注意事项啊，就是说怎么能让你的这个就是设计他能跑的快一点，更加稳定一点啊，就是就是常用的一些优化策略， 那么剩下的时间呢，就是我们会给大家一两个实力啊，实力大买就停给大家了，然后我们来看一下啊相关的这个演示过程。 好，那我们首先看这个呃的就是基础要点啊，这是基础要点呢，这个右下这个图是整个阿 tl 级的这个设计流程，就我们之前已经 就是昨天已经这个给大家讲解过了啊，讲解过了，所以呃基本的 fpj 的设计开发流程他是基础啊，虽然我们就是讲的是这个神经网络的这个实现，但是他的开 流程和之前的这个 fbj 的 rtl 设计啊，是保持一致的啊，是保持一个，那么在这块呢，我们昨天也也了解到了，对于 fbj 来说，对吧？他是 要支持完全的并行啊，只要资源足够的情况下，我们是可以对 fpj 芯片内的那些资源去进行定制啊，就是他，他为什么叫半定制的芯片呢？就是在 fpj 内已经就是厂商已经做好了一些基本的模块啊，就跟你 在这个小朋友家，就家里小朋友玩那个积木颗粒似的，他已经预制好了啊，那设计者呢？他要做的就是把这些预制好的基本模块哎，通过某种方式连起来，对吧？你可以不同侧面，有车，有串型的，有病型的，有流 水线的等等啊，连起来能达到自己的目标。所以 lpg 它的特点呢？它具有很强的这个病形性啊，也非常的适合流水线的处理。而我们昨天讨论的这个卷机神仙网络，你会发现它的特点是， 对吧？大家回顾之前的结构，就他的模块化非常的好，很规律，对吧？他的结构一般是卷基层加上这个人露层加激活层嘛，加上这个石化层啊，这样形成一个一个模式，一级一级的叠在这个嵌套，而且他 比普通的这个神经网络而言，他具有参数共享的特点啊，那么这个卷机神经网络呢，他是非常适合这个 fpv 加速的，对吧？你参数共享的话，昨天我们已经也了解到了，你才用参数共享了解 局部视野，实际上你用小的卷机盒能够有多个小的卷机盒的这个重叠和深入，是能够这个替代，或者是这个兼容大的卷机盒，他的这个感受也的啊，那这样情况下呢，我们可以使得就是，呃，参数 规模是可控，对吧？你可以控制下采取规模，同时呢他也方便啊，他也方便实现，就说他有很强的这个牵引性，你不用再对整个 以图像处理为例啊，你不用再对整个图像的所有位置进行分析啊，你的局部位置的分析或者获取的这个特征，他是可以迁移到你其他位置的啊，所以这像这种方式呢，很适合并行的处理，也很适合流水线的处理啊， 那么跟 fpj 的资源非常的契合。那么我们在采用这个阿 tl 进行神经网络设计的时候呢，前面我们也了解到，对于整个神经网络来说，它实际上哎又分成两个阶段，第一个阶段就是我们有训练和验证阶段， 那目前来说呢，在我们的通用平台，我们昨天介绍的这个 cpu 和 jpu， 在我们的通用平台上他有很好的这个生态以及工具链， 对吧？他从平台上现在有很多的这个框架把拍他吃啊， tenseflow 等等，昨天我们有有同学呃使用过他啊，经常的使用过，对吧？会用。 那么我们在前期呢，网络的这个结构啊，参数的定型啊，训练啊，验证啊，都可以在通用平台上利用良好的这个 就生态环境或者工具来完成训练后的推演。那么导出啊推演你确定没有问题，而是这个整个网络结构没有问题，参数 啊，包括全职等等，他已经确定了之后，哎，我们再把它导出啊，就进入我们的 rtl 的实现阶段，就是进入第三点 itlg 实现阶段，我们要做什么工作呢？那是让我们做的，首先是你要对这个神经网络的这个算法进行拆解和分析， 当你整个十年后网络算法里面他需要哪些计算资源？是让就你需要把你的这个算法他要改，改成这个 fpj 跟他 fpj 内部结果比较契合，跟他 fpj 内部资源比较契合的这样的一个 一个状态，对吧？所以你要你要计算，那是我们昨天给大家讲的，你要计算他需要的这个存球容量，你要计算他的这个贷款 啊，你要分析他的各个，他是哪个级别的算子级别还是层次级别，或者是整体网络级级别，他的一些计算瓶颈啊，计算瓶颈，那么一般来说呢，我们在 这个这个神经网络实现的时候，其实目前哈就是这个性能平静，主要是在于卷机运算的时候，会有大量的这个成家的运算， 就是我们要解决这个成家运算的问题，对吧？你怎么让他算的更快啊？怎么，怎么让他去不局不限更好。那么在参与运算的时候呢，会有很多的这个全职参数，那么这个这个参数卷机盒等等会带来 很多的这个仿存的需求啊，带来很多的仿存需求，所以这是我们目前就是常见的，或者是经常需要过重点关注的这个关键。计算平静， 那么这些确定之后，一般在进行正式设计之前啊，就跟我们学习软件似的，你在你在呆马化之前，你在抠定之前，你肯定是要先对 这个算法要进行完全的这个设计啊，要进行算法进行完全设计，所以对于我们这个阿提妖级的神仙网络的实现呢，也是你在做拆解之前，你需要 提前确定好是以网络结构和个人参数啊，这个就是我们在这个通用的啊，就目前还是在通用的 cp 和真皮物上来完成，因为你这样都 确定完了之后，他主要是为了避免你在 fbj 开发过程中中途你再去修改这个网络结构或者修改参数，这样的话可能时间就有点得不偿失了。因为如果你 rtl 它的这个设计层次还是比较接近底层的 抢救硬件描述也还是会有一定的这个门槛值，你要去完成一个，当然这个你可以跟我们明天再给大家介绍的，我们在高级人层上走去做啊，跟那个做对比，你会发现，哎，高级人上的层次上的那个设计会更快点一些啊，那阿铁奥级的这块是基础啊，是基础 啊，但是呢，他确实他的这个你要改动网络呀，或者是呃，参数，特别参数个数啊，量化精度他要变化的时候呢，有可能会带来这个就是重要的这个调整啊，重要调整。

五分钟快速上手 spy glass 分析 rtl 设计，热爱硬件科技，享受幸福生活！大家好，今天给大家五分钟快速介绍一下 spy glass 是怎么用的。 首先我们在使用 syr 之前呢，首先要写一个这个 e d a 工具的约束文件， s gdc 文件，那么这个文件呢，实际上跟正常的约束文件比较像，一般情况下呢，我们只需要遵循这个特定的格式呢，就可以写出一个比较简易的约束文件。首先呢第一个呢就是 整个设计的顶层模块的名称，然后呢是时钟的信息以及 位的信息，简单说呢就是三步，第一步呢就是顶层模块的名字，第二步呢是顶层模块输入适中，第三步呢是顶层模块的复位信号，就这三个。然后呢我们保存之后呢，我们就可以打开我们的 spa glass 进行操作了。 好，打开我们的 sway glass 之后呢，我们首先呢要添加文件， 首先把我们所有设计的 rtl 文件加进来，然后呢再把我们的约束文件加进来， 好，我们保存一下， 起个工程的名称。然后呢我们这个时候呢要对工程进行一个设置，选择这个 set options， 然后呢第一行填上我们顶层模块的名称，与约束文念中要保持一致。 然后呢这个选项建议大家选上，因为有的时候你原文件是带有 system vlog 的，建议大家选上，然后我们再保存一下工程， 然后呢此时我们将工程的原文件以及最基本的设置已经完成了之后，我们点这个读取设计，然后点个读取好，如果我们左下角这个所有的都是绿色的信息，然后呢左边这个框呢已经 展示出完整的这个结构，包括顶层和下面的啊调用的绿化的模块，这样的话呢，说明我们这个工程已经编译成功了，那么这个时候呢，我们就可以进行下一步操作，如果这个里头有爆红色的信息，一般呢都是语法错误，这个 spa 格拉斯检查语法检查的比较严格，所以如果呢有语法错误呢，这里都会爆出来是红色的，你需要进行修改之后重新的读取这个设计。之后呢， 等到左边这个框出现了这个完整的结构， rtl 结构才能是正确的读取了所有原文件。 好，然后此时呢我们一般都用它来分析一下 cdc， 就是一些持续胎命方面的一些问题，我们选择这个，然后呢选择这个 cdc 都全选之后呢，我们点击 这个运行目标即可等待结果输出， 输出完成之后呢，我们在左下角这个框里就可以看到这个检查的信息了，绿色的呢代表设计的是都没有问题的， 一般呢这里头可以检查出异部信号是否没有处理，就使用组合逻辑是否有毛刺，以及一些其他的错误信息，这里都会列出来，我们一般呢参照这个错误信息呢，要对这个设计进行修改，保证啊条扣的是正确的，尽可能的不要出现任何红色的， 这样的话呢，在你实际使用 r t r code 的时候呢，确实可能会出现问题，这个呢就是 spy glass 的强大之处，它可以分析出你这个点赞里头的一些你忽视的一些问题。

小伙伴们大家好，我是皮特派皮老师，本期我们仍然来分析实序， 今天要讲的是大家比较关心的重点内容，不同速率同步系统的 rtl 设计和实序分析。 在本期的课程当中呢，我会教大家面对不同速率的同步采样系统在 rtl 上如何处理，在实序上呢？又如何分析 这些内容大大家应该在其他的场合，比如学校，公司或者是其他 up 主的视频当中很难学到的 啊。快过年了，所以在进入今天的正题之前呢， up 主提前给大家拜个早年。过去一年算是我做芯片类视频的第二年了，相信大家也感受的到。我的视频内容呢，比较硬，不是那种大家平时在坐公交 的时候或者是吃饭的时候用来打发时间的那种宽泛意义上的科普视频，而是需要拿个本子跟着 up 主讲的内容一起写写画画 才能够理解的视频。很多知识的理解呢，需要把视频暂停再想一想才能理解。所以我的视频看的人真的不多啊，很多时候花了半天的时间做的视频， 点赞量也到不了一百啊，投币量也大不了五十，跟其他知识渠大部主没法比，所以有的时候我也想就此 over 得了啊，但是呢， 还是决定挣扎一下吧，作为一个知识分享的爱好者，我的视频还是尽量会做下去的。嗯，虽说工作忙的时候会来不及做哈，但是今后一年还是会继续的。其实做视频也是在记录我的生活历程，作为一种日记 也是有价值的。还是请大家如果从我的视频当中呢，得到了些许灵感的话，给这个视频点个赞，投个币，推荐给你的同学同事。我希望我的这个频道不只是 up 主一个人的一言堂， 而是能成为一个大家相互交流、沟通、讨论的平台，在碰撞当中共同促进大家的成长。 好，那我们现在就进入正题那个第三章呢，我们相当于是留了一个，卖了一个关子啊，等到我们把这个快到慢的这个问题讨论清楚了以后，我们一起来讨论。大家来看这个快很慢啊，这个上面的克拉克，一是快速适中来右那面 下面这个科二科二是慢速适中的九大秒，所以按照我们的那个分析范围，他就是这段范围，是吧？这段范围上面是三个周期，下面两个周， 我们只分析这段范围，那么我们看这个发出的数据是 bb， 哎，为什么这个地方不发出了，这个地方的 a 发出了 bbb， 对吧？那么这个 b 上升严呢？应该发出个别的东西，那为什么这不发出了呢？大家来看我这里，假设 这个是 a 发出来的一数据， b 发出来二数据， c 发出来三数据， d 发出来四数据， e 发出来五数据， f 发出来六数据，这样每一拍我都会发一个数据，请问我的 h， 我 h 要踩到的是二，是不是踩到二，那么 i 呢？ 踩到是三， j 呢？踩到是五，大家看，那这个四怎么办？四我漏掉了，是不是一我也漏掉了，没人踩对不对？那么这就是体现了从快 快到慢的一个速度上的问题，就是如果快速使重，每次都要打一个数据的话，那我慢速始终是踩不到的，所以对于快到慢，他不可能每一排都要打出一个数据来，而如果每一排要都要打出一个数据来的话，下面科二是没有办法踩的， 所以它即便是时钟快，它的数据其实本身不快，它的数据要符合这个 clock 二的要求。大家来看，我这个周期呢，是六个纳秒是吧？那么我不能按照六个纳秒来发数据，那我只能按照 我这下面是九个那秒，我难道说按照九个那秒的方式来发出去吗？我发不出来，我发不出来，我只能按照倍数的方式来发，也就是说我必须要按照十二个那秒，或者是更慢的方式来发。所以大家就可以看到 像图中这样啊，我 a、 a 和 b、 b、 b 都是数据 b， b， b， c 和 d 啊，都是数据 c、 c， c， e 是拍出来 d， d， d， 这样呢，我才能够踩到。 那么这样看来，我的 g 眼能够踩到啥呢？能够踩到 a、 a、 a、 h 眼呢？能够踩到 b、 b、 b、 i 眼呢？能够踩到 c、 c、 c 这一眼呢？能够踩到 d、 d、 d， 对吧？ 这样我就能都能猜到了，但是大家看没看到，我虽然把一个从快速到慢速的问题转化了，让 clock 二都能猜到，但是他变成了一个什么问题呢？数据从六那秒 周期变成了十二那秒周期数据我们不看时钟，主要看数据，数据变成了十二那秒，那么对于 cluck 二来说，他是十二那秒到九那 大秒采样，这是啥？这是从慢到快，把一个从快到慢的问题转换成为一个从慢到快的问题， 也就是说我们一般处理问题的办法呢，就是看到一个从快到慢的问题，那么先把它转换成为从慢到快的问题， 再给它转换成为同等速度，就是说 clock 一和 clock 二速度相同的问题。那么有同学问，为什么不直接把从慢到快转换成为同等速度？因为我刚才解释了，我没有办法，他是六拿命， 我的数据只能是他的倍数，要么就六那秒，要么就十二那秒，我只能选择十二那秒或者是十八那秒之类的，但是他是九那秒，科二是九那秒，所以我没有办法变成同等速度是九那秒，我只能是先从快到慢变成从 慢到快，然后再让他们同等速度。那么如果大家遇到的是从慢到快的问题，那就直接转换成为同等速度的问题。所以老师这里讲的呢，不光是持续分析的方法， 还是一个 r p l 设计和思路的方法，就像 five five 最主要的作用是调节速度啊，我们一个发射， 一个接收，他两个速度平均下来是一样的啊，比如说都是五十兆大币每秒，但是呢，这个发呢，发送设备有可能会突然抽风一样，他变成了一百兆币 每秒，他会突然发疯变成一百兆 b 每秒，这个一百兆 b 每秒可能会持续四秒钟的时间，而这个时候如果他发这样的一个 速度的话，我收端我是没有办法收的，对吧？我只能处理五十兆币每秒的速度，他平均下来也是五十兆币每秒，但是他偶尔会发一百兆币每秒，那意思是说他既然平均是五十兆币，那他偶尔是一百兆币，那意思就是说 他可能在另外一段时间比这个五十兆币还要小，比如说是三十兆币，明明，对吧？这样他就能平均出来这个五十兆币，那么他们两个的平均速度是一样的。 他抽风了怎么办？他处理不过来，那数据就会丢失，对不对？他给的多了，他吃不过来，他数据就会丢失，那怎么办？中间要加一个 five， 那 five 是用来干什么的？ five 就是用来平衡速率的，当发送端他抽风的时候，他给的特别多的时候， 能够在 five 当中有一个缓冲，缓冲的长度是多少呢？就是你给的多出来的那一部分。比如说我这个我一秒钟只能吃两个馒头，你突然给了我四个馒头，那我一秒钟只能吃两个馒头怎么办？剩下两个馒头存在 five 当中 啊。如果你一秒钟变成了十个馒头，我还是只能吃两个馒头。那这个 five 的长度开到多少？开到八个 对吧？因为你要存储八个馒头，但是你这个速率不能持续，必须从长期来看，你平均下来都是同等的收发量。平均下来我这个一秒钟给我两个馒头， 我收他平均下来，我这一秒钟只能吃两个馒头。平均下来都是可以的，只不过是突发的时候会你突然给我十个馒头，这样的时候 five 才有用。 如果你长期下来都是比我收的要快的，长期下来这是无可违纪的，是吧？你开多大的反复都没用，那么这个 clock 也是一样的道理啊。我这个一直快，他一直慢， 就意味着说我一直会漏掉数据，所以你你每拍都拍出来一个新数据，我是根本没法收到的，你只能降速，降速，那我还有有一个重复采量的问题，是吧？我刚才举的那个例子，一二三四，我发出来一二三四，我收到是一二二三四，所以这个时候呢，我们就要去想办法 让他那个一二二三四变成一二三四。那么在讨论我们具体 rtl 怎么写之前，我先问大家一个问题，那么这个时候 我们的分析范围应该是多少呢？啊？还是刚才那个十八那秒吗？不是的，因为 data 二第二，它已经变成了十二那秒的 频率了，一个一个周期了，而这个 clock 二呢是九大秒，大家来看他们之间的最小公倍数是多少？是三十六四九三十六，这个十二大秒呢是三倍的，也就是说三个 data， 三个周期的 data 以及四个周期的 clock 才能够达到那一个分析范围的目的。 那么这个从这开始，一个周期，两个周期，三个周期，四个周期到这，这是一个分析范围，我们从慢到快一定会有重复采样，我们看看有没有重复采样。 h 踩到的是 b、 b、 b， 是吧？ b、 b、 b， i 踩到的是 c、 c、 c， 这呢踩到的是 d、 d， d， k 呢？踩到是啥？ k 也踩到是啥？也是 d、 d、 d 呀？啊，所以这个里面从 h 到 k 这四个采样颜，一个两个三个四，这四个采样颜，其实这个里面呢是三个数据， 但实际上他踩到四个踩到是重复的 d、 d、 d， 那么对于这种情况我们怎么办？我们把四个踩扬严变成三个，这样不就造成了说，哎，我的这个 data 是三个周期，我的 clock 二 也是三个周期，那么克拉克变成三个周期，也就是十二个大秒了是不是？那我们到底消掉哪个才养颜呢？这个 h 消掉， i 消掉， g 消掉还是 k 消掉？大家要知道啊，这个我们的分析范围是四个，所以这个 g 也就是这个 k 是一样的啊，这个 aa 所扮演的角色和 d d， d 的扮演的角色是一样的，所以我们这里只分析 h， i j 和 k 到底消掉哪一个，那我们就看看这个里面哪个时序更紧张嘛？ a 是 lunch， h 是 character， 诶，这 这段比那个从 a 到 b 的时间还要长，是吧？还要长。建立时间，保持时间我们就不讨论了，保持时间我们刚才说过了，就是两个沿对齐的时候保持是最长的，而且是梯后的，他跟什么快到慢呀？慢到快都没关系， 跟你同频同相啊，什么都没有关系。所以我们最主要的还是讨论这个建立时间，从 a 到 h 的距离是比较长的啊，这建立时间是比较好满足的。 b 是不不浪池的，是不是 b 没有浪池？大家看 a 和 b 都是 b b b， 它的数据都是 b b b， 所以 b 没有浪池， c 是浪池的 c， 浪池出来给 i 是吧？那么这个呢，就相当于是一一个六纳秒，这一个六纳秒，这是一个多少呢？这一个 clock 一周期在 加半个 clock e 周期，那就是六加三啊，等于九九个大秒，这是六个大秒，这稍微比这个 a 到 h 要长一些啊。那么 e 浪尺出来被 j 来踩，这个是最短的，这个长度有多少呢？这个长度是半个 clock， e 的周期就是三大秒， 这个三大秒是最短的，那我们把它给去掉，让它不要踩，那么它不踩的话是它浪尺到 k capture， 也就是说这三条采样路径就确定了， a 到 h 啊，它的赛场排名九个大秒，从 c 到 i 是六个大秒，从 e 到 k 是九个大秒，那么这个究竟代码怎么写呢？ 啊？这里面呢，老师给了两个东西啊，一个是波形，一个是代码，那波形呢？大家来看 clock 一，我们就不管他了啊，他是这样的， 哎，为什么少了几个？他不是六那秒一个，六那秒一个吗？为什么少了几个呢？是因为啊，我们在拍出这个 b， b， b， c， c， c， d， d， d 的时候，由于我们在 vlog 当中做了这个类似于这样的作者， 就是 lsf， 它会自己的自动插入那个门控时钟，插入门控时钟里以后呢？这原本这个地方有一个凸起，对吧？这个地方有一个周期是吧？由于插入的门控时钟以后，就把这个时钟给屏蔽掉了， 因为你只用到了这个时钟，这个时钟岩，这个时钟岩，对于没有用到的时钟岩，他综合器会自动的插入门控时钟， icg， 把没有用的这个失重周期给它屏蔽掉。所以实际的波形不是刚才我们画的那个密集型的六纳秒的波形，而是 十二秒的这种啊， b， b， c， c， d， d， e， 那么接下来呢，我们用这个块儿产生了一个 counter， 产生了一个技术器，大家来看，就这个，我们是工作在 clock 二上啊，我写了一个 office， 产生了一个坑特，工作在 clock 二上，那 clock 二，我们说了，我们是每四个周期其中去掉一个周期，是吧？我们去掉哪个周期呢？一二三，第三个周期，就这个 j 去掉四，那我们就数二， 这是时时间的起点，是吧？那我们始终开始从这拍看到了一个 clock， 我们就数一个数，一二 三四一，就这样重复，一二三四，一二三四，一二三四，一二三四。好，那我这个地方也可以，我现在开始复位的时候是零啊，我看到一个是 中上声音，我就加一，那就是零，加一是一，然后如果是大于等于四的话，那我就会把它再变成一，也就是说从四变成一，这样的一个过程循环反复执行。接下来呢，我又产生了一个 用 counter 产生这个第二 valid， 我这个 counter 为什么要产生它？就是为了产生第二 valid。 这第二 valid 呢？是 一二的时候，当 counter 等于一二的时候，就是一四的时候，我也是一，当它是三的时候，我就陷下去，我不要它啊，所以 counter 不等于三的时候，我这个就是一啊，这个三。 接下来我产生了这个第二 valed 以后，我的目的，我的最终目的是什么？最终目的是踩 q 二，是不是就是得到 q 二，我采集第二，得到 q 二，那我最后要得到 q 二， 我这三个逻辑呢，都是在 clock 二这个始终率上完成的啊。好，那我们遇到这个 clock 二以后怎么办？遇到 clock 二，我先看这个 valid 有没有 啊？这个 y 类的有，有。踩，踩第二，踩到个 a a a 是吧？好，我这个遇到第二 y 类的有没有？有啊，我就踩，踩到一个 b b b 啊，踩到一个 b b b， 然后这个 i 呢？ 看第二歪类的有没有？有，那我踩到一个 c， c， c， 是吧？那遇到一个 j， 然后我再看，哎，这个第二歪类的有没有？没有，这是零，大家看是零， 零的话呢？我就是没有采样到 d， d， d， 我没有采样到 d， d， d。 我们刚才说了，他这个时间太短了。三， 我不想要他，他这个时间太短了，我不想要他，反正我有踩的，我这个 k 也可以踩这个 db， 我不需要这个 g 来踩，所以我把它屏蔽了。当第二 y 里的等于零的时候， 我就没有踩到这个 d， d， d， 我过去了。那 if， d， r 发类的等于一的时候我才会踩，等于零的时候我不踩好，那这个 j 就过去了。 k 呢？是一，他踩， 猜到了，猜到了 d、 d， d， 所以大家看 a， b， c， d。 我们刚才说了说 从快到慢，先要变成从慢到快，最后变成同等速度。如果大家是直接是从慢到快，那就是最后变成同等速度。我们现在变没变成同等速度，变成了，因为它是排除了 b， c， d， b， b， c， c， c， d， d， d。 那么我干掉了这个周期以后，也是 b， b， b， c， c， c， d， d， d。 那么 clock 一和 clock 二都变成了同等速率的一个传输，只不过最终变成的这个同等速率既不是 clock 一的速率，也不是 clock 二的速率， 而是两者之间的一个平衡，大家要理解。那么我们刚才说有了，插入了市中门控以后，这个没有了，是吧？那么我们这也会自动的插入市中门控。 这个大家看第二章啊，这个数学规范和省电低功号的那一部分，我们有讲这种表达方式，如果我没有写 ls， 那我再写一个 ls 啊， q 二等于零，这样就不对了啊，这样就不会插入那个 i c g， 那么如果我不写，那么他就会插入 i c g， 插入 i c g 的话， 在这个科二上他会插入一个时钟门控，这个时钟门控把谁给屏蔽掉了？把这个 g 屏蔽掉了，所以这个 g 大家看我画了一个灰色的，意思是他只是在大家的想象当中是有的， 实际当中它不存在，也是像这样啊，直接连线连过去，所以这个 r t l 代码就是这样写，从慢到快，从快到慢，大家学会了吗？ 那最终呢？像这种语法呢，它会综合出一个这样的电路 clock 二啊，进来，进来以后，它不是直接怼进来的，它是这儿有一个 i c g 的开关，有一个时钟门控开关，它这个开关是闭合还是断开呢？是由第二 value 的来决定的，当第二 value 等于一的时候，它就闭合， 始终就能进去。当第二 y 等于零的时候，始终就断开，他就没有始终，他这个 q 二就保持。 对于科二的总的这条线路来讲，始终门控是不会插入进来的，他只是插入到这个分支，就是刚刚要进入到出发器之前的这个位置啊，不会把这个开关放在这啊。所以大家来看，刚才我们说这个 drilet， 它等于零的时候， 那个开关是断开的，所以始终是没有跑进去的，那这个问题从 rtl 的角度是解决了，对吧？那大家看，我们把这个这个干掉了，那么本来限制我们的建立时间的条件是这个 tb 一这个条件， 那这个 j 由于被干掉了，那限制因素就不是他了，是吧？就不是他了，那是他吗？也不是，因为我们刚才算说过了，这个是九大秒，这个是九大秒，这是六大秒。所以最终我们最紧 的始终其实是这个啊，从它 lunch 到它 character， 这个是最紧的了啊，这个已经删掉了。这个不是最紧的啊，这个是最紧的。 所以最终我们的这个失去率变成了什么呢？就变成了 t real 小于 t b 减去 t set up 大于 t 后的，那么这个 t 后的 t ctrl 不变 t b 呢？转移了啊，这过去 t b 在这儿，现在这个 t b 呢？是，嗯，这个之间的距离，这个是最紧的。但是呢， 工具会不会知道我们这个 tb 转移了，从这转移到这了？他有可能不知道啊，有可能他分不清楚啊，在先一开始呢，他没有看清楚，这个东西仍然是按照我们当初约束的啊，这个地方是 clock 二这样的一个 clock 九那秒的一个 clock 来去进行分析的，一个一个进行分析。 于是呢，他就仍然可能把这个 e 和这个 j 看成是最紧的言。也就是说，虽然说我们代码已经这样写了，我们认为应该是高枕无忧了，但实际上他会爆出一些 negatives like n s 是负的啊，负的 stock 报出来一个他要求的时间是这个时间，那就是出乎我们意料了，是吧？那如何才能够让工具也知道啊？这个时间是我们不需要分析的啊，我们需要分析这个时间呢，那就是把 clock 声明成这个样子啊， 这样的工具就会知道了。你只需要分析啊，这几个，这几个眼，这这个眼，这个眼，不想分析这个， 那我们刚才说的呢，是两种约束情况的一种啊，就是当 clock 二的速度不是第二速度的整数倍的时候，我们是需要啊声明这个 create clock 的时候，给他声明成这样 一个波形啊，为什么他不是整数倍呢？大家看这是九那秒是吧，这是十二那秒，所以他不是整数倍，如果是整数倍，就是我们是从慢到快啊，那么如果这个快的速度是慢的速度的整数倍的话， 那么就应该使用 motorcycle 的约束方式，这样呢更加的简单一些惹。 motorcycle 呢，我们将在后面的三点四节啊讲持续的约束的时候呢，再给大家详细的讲一下。但是呢，这里需要强调的是，不管是 啊，不是整数倍的情况，而是整数倍的情况，像这样的一个约束啊，还有那个 motorcycle 的一些约束都是比较少见的一种设计的方法，我们设计人员呢，一般不会把自己 的设计变成这样的一个比较繁琐的一情况，那怎样才是一个比较常见的设计呢？就是我们会尽量的打破可乐和一和可乐和二之间的持续的约束关系，也就是说把他们两个当成是两个异步的，始终 两个翼步的适中，那就意味着他们是不需要关注持续关系的，也就是浪齿炎和 capture 眼中间的这个持续关系的中间呢，要做一个翼步适中的一个握手，或者是中间加一个翼步的发否。 这个在前面的章节我们都已经介绍过这个跨时钟与一步处理的方法，我们主要用的是这种方法啊，就很少使用说这两个时钟，嗯，是这样的情况之下呢，还要去关注他的这个时序，这是第一点。那么第一点呢，我们就总结为，对于复杂的时序问， 我们要转换成为 e 不 cdc 问题来处理啊，就不是直面他的持续问题，而是绕个道转换成为一个比较呃，握手比较慢啊，但是呢，我们可以保证他正确的一种方式。 第二种呢，就是对于同源的时钟，我们尽量的使用原始中来配合 valid 写这个 vlog， 而不是使用这个 clock 一和 clock 二这种方式。 那么什么叫做原石中配合 valley 的呢？那么假设这个地方是十二十二个那秒，对吧？这个地方是九个那秒，那么他们的原石中呢，可能是三那秒三那秒周期的一个圆头时钟， 那么由这个三大秒为周期的源头始终，这个快速始终呢，衍生出了这个第二啊，也衍生出了这个 clock 二。那么整个这个逻辑，大家看好像是一个 从快速时钟到慢速时钟的一个转换的逻辑，或者是从慢速时钟到快速时钟的一个转换的逻辑。但实际上从源头来讲，它只有一个时钟，就是这个三代码的 clock， 那么我们写代码的时候就直接一直写，而 always at pose h clock all negat 指 reset， 然后我们都用这个 clock 这个三代表的 clock 作为它的始终。然后呢，每次遇到这些问题的时候，就这些真正的 capture 严，真正的 latch lunch 严的时候，我们就用 valid valid 来代替啊， clock 二有 clock 二的 valid， clock 一呢就 clock 一的 valid， 这样的效果呢，做出来就像这样，它会自动的插入时钟门口啊，就相当于是说我们的这个时钟啊，是九个纳秒是吧？九个纳秒相当于是三 三个我们的 clock 周期，那么什么时候它会产生 y 类的呢？在这个地方产生一个 y 类的， 那那这个时钟周期也是我们三个 clock 时钟周期，然后在这也产生一个外面的 这个所谓分频的时钟，其实也可以用 valid 来代替，那这样的好处就在于什么呢？ 在于我们在持续约束的时候比较简单了，综合工具呢，就会去自己去分析， 所以综上所述呢，不管是从快到慢啊，还是从慢到快，都是比较少用的一些处理的方式。我们最常用的还是这两种啊，一种是 最复杂的时钟转换成为 c d c 的问题，第二种就是对于同源时钟，我们仍然是使用它们的公共源头时钟，然后再加 value 的，这种方式更为常见。

大家好，我是立国说电脑，今天呢有位顾客，他拿来了一个机箱，然后让我帮他看看他这个电脑是否可以开我们这个手用模拟器，然后下载这个手游模拟器， 然后什么是手游模拟器呢？手游模拟器就是我们通过电脑下载一个手游模拟器，然后我们就可以进行玩手机里面的这个游戏，还有一些啊程序啥的。然后呢，我们首先先测试了一下他的配置， 他的处理器，嗯， cpu 是一个一五的至强一五一个服务器的 cpu， 然后我们看一下他的内存，他的内存是个十六 g 的，然后，嗯，第二三三代的，但是这个频率有点低，是一个幺三个三的。 然后我们再看一下他这个显卡，他这个显卡是一个呃，七五零的显卡，一 gb 也不是很高，然后佩戴了一个一百二 g 的固态。其实啊，我们这个开模拟器，这模拟器对于我们这个电脑配置不是很高要求， 只不过是里边这个游戏要求这个配置比较高一些，像他这个配置，大家问可不可以这个下载这个模拟器玩？其实可以，但是只不过只可以上里边玩一些，比如说消消乐啊，或者是一些小一点的，不吃，不是特别吃显卡内存的一些游戏，如果玩一些什么和平精英，王者荣耀之类的是玩不了的。 然后呢，最后我也给大家建议一个，就是需要什么配置玩这些手磨水器里边游戏差不多都可以玩的一个配置，我给大家看一下， 我建议大家呢，我们这个 cpu 一定要要求在四盒以上，然后内存呢，然后也要求到八 g 以上，然后这个频率一定要在二二三个三以上， 然后显卡呢，两 g 以上，再佩戴一个我们这个固态硬盘。如果说大家说有条件的情况下可以把这些配置再提高，比如我们 cpu 整八盒啊，内存整到十六 三十二 g 啊，然后这个内啊内存频率我们给他调到三二零零啊，显卡是四 g 以上都可以，但是只要高于这个配置，里边差不多的游戏都可以玩。然后呢这期视频我就讲到这里，然后有喜欢电脑常识的朋友可以关注我，谢谢大家。

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明明用的千兆网络，路由器也换了无数，但电脑总是网络不好，还常常断开连接。其实是这个设置没有打开。锻炼手指的一天， 分手开始。右击我的电脑，点击管理，在设备管理器里找到网络试配器，其中名字带有 wir 或 wifi。 六才是决定网络的网卡设备。右击点击无线网卡，选择属性， 进入高级选项，下拉菜单，将选项中平带改成五 g 网络，最后把吞吐量助推器启用，点击确定即可。飞一般的感觉，快去试试吧，记住，专业的事找专业的人做。

咱们研究一个，用最便宜的配置看看，研究一个玩英雄联盟流畅的配置啊， 这个是七三零 mb 速龙七三零，这个不带核，显得需要显卡，然后配一个本一七五两条内存，然后显卡咱准备了两张啊，一个是六幺零卡，一个是六五零卡，咱看看到底是哪个卡，行，咱就上哪个开装 这一套啊，先给这个六五零整上了，开机做个系统啊，这个太慢了，做完系统了， amd 速龙七三零，嗯，插了两条内存， 全款是六零仪器。来咱试试啊，看看玩游戏能玩不？这是钢筋泉水，一般 五六十针，这对线的时候针数下来了，六七针，还是这套设备啊。显卡现在换成 gt 六幺零了，我掉这六幺零显卡不行了啊， 三十针，哈哈，对线针会上来点。我又在显卡堆里翻着了一个 gt 六三零，看一下这个六三零，两 g 微星的，咱试一下这个，这是六三零，显卡进去七十多针， 对线看一看啊，对线还凑合吧，六七四针，反正六三零还算可以，玩六幺零是肯定不行的。 这三张显卡给测完了，六幺零，六三零，六五零，这六三零还可以吧，能勉强能玩最低配置，这个六五零的话还可以，那六幺零就放弃吧，今天就这样吧，下课。