摩尔定律玩了六十年,把晶体管越做越小。现在呢?3nm撞墙,EUV光刻机一台十几亿,晶圆成本破万美元。路,到头了。 华为怎么办?不硬刚尺寸,改抢时间。 华为在ISCAS 2026上,首次提出"韬定律"。 A股半导体板块闻声暴涨。先进封装指数飙涨7%,通富微电、晶方科技、华天科技集体涨停。 这不是概念炒作。这是中国人第一次在全球半导体领域,定义自己的产业演进原则。 什么叫韬定律? 一句话:用"时间缩微"替代"几何缩微"。 摩尔定律比的是谁塞的晶体管多。韬定律比的是谁让信号跑得更快。 核心抓手叫"逻辑折叠"。传统芯片是平面摊大饼,信号左冲右突,时间全耗在走线上。逻辑折叠把电路从"一层楼"折成"多层楼",关键路径纵向打通,物理距离大幅压缩。 这不是纸上谈兵。华为干了六年,量产了381款芯片。麒麟2026首发搭载,晶体管密度跃升55%,能效提升41%,频率提升13%。 逻辑折叠要落地,靠谁?先进封装。 电路折起来了,物理上怎么叠?靠3D堆叠。信号怎么上下贯通?靠TSV硅通孔。多层芯片怎么无缝粘合?靠混合键合。 没有先进封装,逻辑折叠就是空中楼阁。 所以韬定律的真正战场,不在晶圆厂,而在封装厂。ABF载板是地基,键合设备是钢筋,CMP抛光、电镀、减薄每一环都不能掉链子。 封装,从产业链末端一跃成为性能决定端。 国内先进封装企业已形成明确梯队。 第一梯队,三强争霸。 盛合晶微,"垂直尖刀"。脱胎于中芯国际与长电科技,2.5D封装国内市占率85%,毛利率35%冠绝行业,华为昇腾的核心"贴身保镖"。 长电科技,"全能平台"。全球OSAT第三,2026年砸下百亿资本开支猛攻2.5D/3D,XDFOI平台覆盖全品类,客户分散、底盘最稳。 通富微电,"弹性先锋"。深度绑定AMD,CoWoS月产能冲刺1万片,2026年Q1净利润暴增224%,AI芯片景气度的"放大器"。 第二梯队,各怀绝技。 甬矽电子激进扩产,华天科技车规级+2.5D双线并进,晶方科技车载CIS封装增长75%。它们不在C位,但卡位精准。 六十年前,摩尔定律定义了半导体的高度。 今天,华为用韬定律告诉我们:当一条路走到尽头,真正的突破不是继续凿墙,而是换一扇门。 先进封装,就是这扇门的钥匙。 #韬定律 #先进封测 #逻辑折叠 #长电科技 #晶方科技
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淡然20183天前
HUAWEI Tau(τ) Scaling Law 华为代表何庭波在 ISCAS 会议上,核心阐述了华为提出的 Tau(τ)缩放定律:一种替代传统摩尔定律的半导体演进新范式。 背景:摩尔定律的放缓 过去 60 年,半导体产业依靠几何缩放(摩尔定律)推动信息时代发展。FinFET 路线图将寿命延长了约十年,但在 7 nm节点后,几何缩放面临严峻挑战,先进制程成本激增、实现难度加大。 Tau(τ)缩放定律的提出 演讲者指出,半导体发展不应局限于几何尺寸缩放。几何缩放曾自然带来时域增益(更快的晶体管、更短的延迟),但几何缩放放缓并不意味着时间缩放停滞。τ(时间常数)= RC 乘积,从器件层面(皮秒级)、电路层面(纳秒级)到系统层面(秒级),横跨 10 个数量级。通过前端和后端 RC 优化(如高 k 金属栅极、应变硅等),可以在不缩小几何尺寸的情况下提升性能。τ 成为从器件到电路再到芯片的统一优化目标。 核心创新:逻辑折叠(Logic Folding) 逻辑折叠是一种全新的数字电路与系统设计方法,通过垂直堆叠活动层来压缩相邻触发器之间的传播时间,将关键路径门分布到不同层,显著缩短信号布线、降低寄生 RC、减少时钟误差。实现有效逻辑折叠的关键在于极小的混合键合(Hybrid Bonding)间距,需小于顶层金属间距的三倍。华为实现了 1.5 微米 的混合键合间距,对准套刻误差小于 0.5 微米,冗余设计使良率达到 100%。 产品成果:麒麟 2026 麒麟 2026 是首款采用逻辑折叠技术的芯片,基于双层自由逻辑架构。晶体管密度从传统工艺的每平方毫米 1.26 亿个提升至 2.38 亿个;SoC 能效提升 41%,最大时钟频率提升近 13%。SRAM 访问延迟降低 40% 以上,时钟缓冲器数量减少 50%。演讲者预告该产品将于 2026 年冬季 上市。 AI 系统架构:从芯片到数据中心 在 AI 领域,华为推出 Ascend 910C 和 950 超级节点,采用统一总线(UB)协议消除跨协议转换延迟,实现内存语义层的点对点传输。光学互连技术"High One"提供单设备 8 Tbps 带宽,将覆盖范围从不足 1 米扩展至 100 米,使千兆瓦级 AI 数据中心成为现实。系统折叠(System Folding)通过将供电、高速内存和光 I/O 移至垂直方向表面,突破了 2.5D 扩展的边缘瓶颈。
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从摩尔定律到韬定律:半导体六十年范式之变 过去六十年,半导体产业历经巨变,从摩尔定律的辉煌到韬定律的崛起,书写着科技发展的新篇章。 1965年,摩尔定律诞生,它预言集成电路上晶体管数量每18 - 24个月翻一番,性能与成本随之优化。此后数十年,这一规律成为产业“圣经”。从大型机到智能手机,摩尔定律推动着技术浪潮,英特尔、台积电等巨头借此崛起。到2025年,3纳米芯片集成超200亿晶体管,算力密度较1965年提升万亿倍。然而,物理极限与经济困境逐渐显现,7纳米以下量子隧穿效应导致漏电,2纳米单芯片设计成本超10亿美元,EUV光刻机出口管制更让后发国家技术迭代受阻。 2026年5月25日,华为提出“韬定律”,以时间常数(τ)为核心,开启半导体技术新范式。它不再执着于晶体管尺寸,而是聚焦压缩芯片内部信号传输延迟。通过逻辑折叠、混合键合等技术,在7纳米成熟制程上实现性能跃升,使7纳米芯片性能等效3纳米,成本下降40%。目前,华为已量产381款基于韬定律的芯片,预计2031年高端芯片密度达1.4纳米等效水平。 这一转变带来深远影响。产业格局上,欧美坚守3纳米以下极致算力,中国主导7纳米以上系统优化市场,形成双轨并行;应用领域里,AI训练、自动驾驶等将呈现“欧美高端小众+中国主流量产”的稳定结构;创新焦点也向先进封装、光互连等环节转移。 韬定律的提出,是东方技术哲学对西方的超越。它以整体观将芯片视为动态系统,强调协同优化;秉持实用主义,直接回应人工智能时代的算力效率需求;倡导开放生态,呼吁全球合作。从摩尔定律到韬定律,半导体产业正从“空间征服”迈向“时间掌控”,全球科技格局也将迎来东西分庭抗礼的新时代。 #热点 #芯片 #华为 #科技
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